Lagarto: Desarrollo de procesadores Open ISA y S.O. Open Source
Una estrategia para impulsar el desarrollo de una industria nacional de TIC
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Próximos Eventos
Barcelona Supercomputing Center. Formato virtual
Taller de Síntesis. Impartido por Dr. Francesc Moll Echeto
Fecha por confirmar, 2020
Información del taller aquí
CORE 2020, Formato virtual, IPN Ciudad de México
Taller: Diseño de la arquitectura del procesador Lagarto RISC-V
Noviembre 30 - Diciembre 3, 2020
Visita el la página del CORE, da clic aquí
Sección de Estudios de Posgrado e Investigación. ESIME Culhuacán, IPN Ciudad de México
Taller: Diseño de la arquitectura del procesador Lagarto RISC-V
Fecha por confirmar, 2021
Unidad Profesional Interdisciplinaria de Ingeniería, IPN Hidalgo
Taller: Diseño de la arquitectura del procesador Lagarto RISC-V
Fecha por confirmar, 2021
Taller de Síntesis. Impartido por Dr. Francesc Moll Echeto
Fecha por confirmar, 2020
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CORE 2020, Formato virtual, IPN Ciudad de México
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Fecha por confirmar, 2021
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Fecha por confirmar, 2021
Eventos Pasados
Auditorio ESCOM y Centro de Investigación en Computación. IPN Ciudad de México
Taller: RISC-V Workshop in CDMX
Febrero 28, 2020
1a Semana de la Innovación Tecnológica en la Industria 4.0 - Universidad Politécnica de Texcoco
Texcoco, Edo. de México
Taller: Arquitectura de Computadoras con System Verilog
JUNIO 25 - 27, 2019
Industrial Transformation MEXICO 2019
Poliforum León, León, Guanajuato
Stand: Procesador Lagarto RISC-V
Octubre 9 - 11, 2019
Congreso Internacional CORE 2019
Ciudad de México
Taller: Diseño de la arquitectura del procesador Lagarto RISC-V
JUNIO 30 - AGOSTO 2, 2019
Facultad de Ingeniería en Electrónica y Comunicaciones, UV Región Poza Rica
Poza Rica, Veracruz
Taller: Diseño de la arquitectura del procesador Lagarto RISC-V
JUNIO 25 - 27, 2019
10th International Supercomputing Conference in Mexico - ISUM 2019
Monterrey, Nuevo León
HPCA: Elemento indispensable para el desarrollo de una industria nacional de TIC
MARZO 29, 2019
10th International Supercomputing Conference in Mexico - ISUM 2019
Monterrey, Nuevo León
Taller: Diseño de la arquitectura del procesador Lagarto RISC-V
MARZO 29, 2019
International Workshop in Smart Cities
Poza Rica, Veracruz
Lagarto como plataforma para IoT
MARZO 22, 2019
Congreso Internacional CORE 2018
Ciudad de México
Taller: Diseño de la arquitectura del procesador Lagarto RISC-V
SEPTIEMBRE 24 - 29, 2019
Border Tech
Ciudad Juárez, Chihuahua
Lagarto como plataforma para empresas de base tecnológica
SEPTIEMBRE 20 - 21, 2018
Semana de la Ciencia y la Tecnología
Ciudad de México
OCTUBRE 5 - 11, 2017
Congreso Internacional CORE 2017
Ciudad de México
Microarchitecture of the Lagarto I processor
SEPTIEMBRE 25 - 29, 2017
Laboratorio de Cómputo de Alto Rendimiento, UV Región Poza Rica
Poza Rica, Veracruz
Taller: Arquitectura del Procesador Lagarto I
JUNIO 26 - 30, 2017
Taller: RISC-V Workshop in CDMX
Febrero 28, 2020
1a Semana de la Innovación Tecnológica en la Industria 4.0 - Universidad Politécnica de Texcoco
Texcoco, Edo. de México
Taller: Arquitectura de Computadoras con System Verilog
JUNIO 25 - 27, 2019
Industrial Transformation MEXICO 2019
Poliforum León, León, Guanajuato
Stand: Procesador Lagarto RISC-V
Octubre 9 - 11, 2019
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Poza Rica, Veracruz
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10th International Supercomputing Conference in Mexico - ISUM 2019
Monterrey, Nuevo León
HPCA: Elemento indispensable para el desarrollo de una industria nacional de TIC
MARZO 29, 2019
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